帧同步搜索电路。
设计要求：输入数据data为8bit并行数据流，基本结构为数据帧，帧长为10字节，帧同步字为h“ff”。clk为输入同步时钟。如下图所示：
真的“帧同步”
假的“帧同步”
1、搜索出数据流中的帧同步字信号，并给出帧同步标志。2、系统工作开始后，要连续3次确认帧同步字进入锁定状态后才输出帧同步标志。
3、在锁定状态时，如连续出现3次错误的帧同步字，则帧同步标志输出无效，系统重新进入搜索状态；否则继续输出有效的帧同步标志。
4、过滤掉虚假的帧同步字（数据载荷中随机的h“ff”）。5、完成综合后的时序**验证。
6、提交设计文档（含设计思路、hdl设计程序、综合结果、时序**结果及对结果的说明等）。文件名格式为：学号_姓名_课程设计7、提交截止时间：2024年5月20日。
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