FPGA课程设计报告

发布 2022-09-30 22:21:28 阅读 5044

专业:通信工程。

班级:班。姓名:

学号:指导老师:祝宏。

制作日期:11.10—11.20

设计课题1:设计一个可控的100进制可逆计数器,要求用de2-115开发板**。

1)计数器的时钟输入信号周期为200ns。

2)以十进制形式显示。

3)有一个复位端clr和两个控制端plus和minus,在这些控。

制信号的作用下,计数器具有复位、增或减计数、暂停功能。

第一步:参考书中的60进制计数器设计出100进制的加法计数器,用时30分钟;

第二步:仿照100进制的加法可以设计出100进制的减法计数器,用时45分钟;

第三步:将两段程序拼凑起来,利用两个控制端控制加减和暂停功。

能,用时15分钟。

关键词。可逆;暂停;循环计数。

内容摘要。计数器具有复位、增减计数和暂停功能,可循环计数,可用作平时。

的。计数器用。

总体方案。

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