《数字逻辑》第2章作业与习题

发布 2023-05-19 01:02:28 阅读 6206

1.传统的逻辑函数的表示方法有。

和。2.逻辑变量和函数只有两种取值,而且它们只是表示两种不同的逻辑状态。

3.逻辑函数,其反函数其对偶式f

4.函数的最简与或式是。

1.函数的最简与或式为( )

10ab以上均不是。

2.逻辑函数,当abc的取值为( )时,f =1。

3.函数ab与( )

互为反函数互为对偶式相等 ④ 答案都不正确。

1.将逻辑函数写成标准与或表达式。

2.推导出函数的最简与或式。

3.列出下述问题的真值表,利用最小项推导法写出其逻辑函数表达式,并利用公式简化法进行简化。然后写出完整的verilog hdl程序。

有3个温度检测器,当检测的温度超过60°时,温度检测器输出信号为1;低于60°时,输出为0。当两个或两个以上的温度检测器的输出为1时,总控制器的输出为1,以控制调控设备,使温度降低到60°以下。

4.用公式法证明下列等式:

5.用if语句设计一个二选一的总线选择器,当选择信号sel为“1”时,输出qout[3:0]等于输入data[3:0];当sel为“0”时,输出qout[3:

0]等于0。下面程序是否正确?若不正确,一一指明出错的语句,并给出完整的正确程序。

尝试用quartus ⅱ软件输入源程序并进行编译,确保编译通过。

6.若要设计一个带异步清零和异步预置的8位二进制加法计数器,触发信号均为上升沿触发,下面程序是否正确?若不正确,一一指明出错的语句,并给出完整的正确程序。尝试用quartus ⅱ软件输入源程序并进行编译,确保编译通过。

1.逻辑函数表达式的标准形式有和。

2.逻辑函数化简的常用方法有和。

3.函数的反函数。

4.若逻辑函数,则其反函数。

5.函数f=ab+bc+ac的反函数的与或表达式为。

6.若逻辑函数f=a+bc,则其或与形式是。

1.函数f(a,b,c,d)=∑m(1,3,5,7,8,9,10,11,14,15)的最简与非实现是( )

2.函数f(a,b,c,d)=∑m(0,1,2,3,6,8,13,15)+∑d(10)的简化与或表达式是( )

3.逻辑函数的反函数为( )

4.能使逻辑函数为零的变量(顺序为abc)组合是( )

5.下列函数中( )式是函数的最小项表达式。

6.函数是最简( )表达式。

或与与或非与非与非或非或非。

7.在下列表达式中,可以全部用或非逻辑实现的是( )

8.能使逻辑函数f =a b c d均为1的输入变量组合是( )

9.n个变量可以构成( )个最小项。

n2×n2n2n-1

10.逻辑函数f =a b与g =a ⊙b满足( )关系。

互非对偶相等无任何关系。

11.标准与或式是由( )构成的逻辑表达式。

最大项之积最小项之积 ③ 最大项之和最小项之和。

12.标准或与式是由( )构成的逻辑表达式。

最大项之积 ② 最小项之积 ③ 最大项之和最小项之和。

1. 逻辑代数中3种最基本的逻辑运算是什么?

2. 什么叫真值表,它有什么用处?

3. 什么叫最小项,它有什么性质?

4. 什么叫最大项,它有什么性质?

5. 什么叫最简与或表达式?化简逻辑函数表达式的意义是什么?

6. 若,则f 和g各为多少?给出推导过程。

7. 列出下述问题的真值表,写出其逻辑函数表达式并利用公式简化法进行简化。然后写出完整的verilog hdl程序。

1)有3个输入信号a、b、c,如果这3个输入信号均为0或其中一个为1时,输出信号y=1,其余情况下y=0。

2)有3个输入信号a、b、c,当这3个输入信号出现奇数个1时,输出y=1,其余情况下y=0。

8. 用真值表证明下列表达式。

9. 直接写出下列各函数的反函数表达式及对偶表达式。

10. 用公式法证明下列各等式。

11. 用公式法化简下列各式。

12. 一个完整的verilog hdl设计模块包括哪几个部分?

13. verilog hdl模块的各端口数据流动方向包括哪几种?

14. verilog hdl的信号的数据类型主要有哪些?

15. 什么叫做顺序语句?什么叫做并行语句?

16. 判断下列verilog hdl标识符是否合法,如有错误则指出原因。

1)a_b_c, _a_b_c, 1_2_3, _1_2_3

2)74zhc245, \74hc575\, 74hc245,$write

3)clr/reset, \in4/sclk, d100%

17. 逻辑运算符把它的操作数当作什么变量来处理?对于不确定的操作数是怎样处理的?进行逻辑运算后的结果为什么值?

18. 缩减运算符和位运算符有何区别?

19. register型变量与nets型变量的主要区别有哪些?

20. 非阻塞赋值与阻塞赋值方式的主要区别有哪些?一般在可综合风格的模块中使用哪种赋值方式更容易综合?

21. case语句与if-else语句有什么区别?各适于什么场合?采用哪种语句耗用器件逻辑资源更少?

22. 什么是同步清零和异步清零?各适于什么场合?

23. 试用**形式列出任务与函数的主要区别。

24. verilog hdl模型一共有哪几种抽象级别?分别描述的是什么模型?你认为一般采用什么描述级别更合适?为什么?

25. 4选1数据选择器可以有哪几种描述方法?各有何特点?

26. 怎样减少器件逻辑资源的耗用?

27. 在组合逻辑电路的设计中,应怎样做才能有效避免生成隐含锁存器?

28. 在测试文件中,生成时钟信号通常有哪两种方法?假如要生成周期为20ns的时钟信号clk,试给出完整的程序(调用源程序的语句可用省略号代替)。

29. 简述组合逻辑电路的分析方法和传统的设计方法。

第2章习题与答案

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