CAD高级考证复习

发布 2021-04-19 04:20:28 阅读 2191

protel dxp 2004 复习资料。

第一题原理图模板制作。

1. 先在指定硬盘根目录下,以准考证号后8位阿拉伯数字为名建立文件夹,将考试所建立的项目文件存入该文件夹中。

2. 新建一个以自己名字拼音命名的项目文件。例:

考生陈大勇的文件名为:cdy. prjpcb(文件\新建\项目\pcb项目)并将项目文件另存入所建的文件夹中,然后按”确定”。

3. 在所建项目文件内新建一个原理图设计文件(即模版文件),名为:

方法:先在设计项目文件中建立原理**件文件\新建\原理图(图标)),再将“改为“

注意:考试中建立的所有文件有:模板文件),流水灯电路。schdoc(总图)、所有子图如主模块。schdoc等、流水灯电路。net、都要存在该设计项目文件中。

4. 原理图的环境设置:考证题需要去掉标题栏,在“设计\文档选项\图纸选项”左方中间,去掉“图纸明细表”前面的“√”

1) 去掉标题栏:方法为:打开“设计\文档选项”,去掉“图纸明细表”前面的“√”

2) 在“设计\文档选项\图纸选项”页面下设置图纸大小为a4,水平放置,工作区颜色(图纸颜色)为18号色,边框颜色(边框颜色)为3号色。

5. 按试题要求绘制自定义标题栏,样图如图1所示。其中边框直线为小号直线,颜色为3号,文字大小为16磅,颜色为黑色,字体为仿宋-gb2312。图1方法:

1) 上图中写出的文字,如:“单位名称、考生信息、图名……当前时间” 都用汉字输入法输入。

2) 点击“实用工具箱”中的图标“”,按键盘左侧的“tab”,点击“注释\文本”右侧的下拉菜单,分别选择“=organization”、“address1”、“address2”、“title”、 documentname”、“sheetnumber” 、sheettotal” 、currenttime”和“=currentdate”等特殊字符串,并将其放入标题栏中相应的位置。

3) 标题栏中“=organization”等特殊字符串所代表的各项内容均要从“设计\文档选项\参数”界面的“数值”一栏中输入,方法:将“*”去掉,然后按标题栏中的要求输入相应内容。即:

在“=organization”中输入所在单位:华南师范大学增城学院,在“=address1”栏的中输入姓名:××在“=address2”中输入身份证号码,在“=address3”中输入准考证号码,在“=title”中输入该设计项目的电路名称,如:

流水灯电路,在“=sheettotal”中输入该项目文件原理图图纸总数。考证要求:学生信息不允许在原理图中用文字工具直接放置。

注意:1) 要实现上述(2)的转换,必须将“工具\原理图优先设计\schematic\graphical editing\选项”中的第3项“转换特殊字符串(v)”前面画上“√”

2) 填写完标题栏后,要将“汉字输入”转化为“英文en”的形式。

第二题原理图库操作(即:画元件图)

1. 在设计项目中建立原理图库文件文件\创建\库\原理图库(图标))

2. 在库文件中建立带有子件的新元件。样图如图2所示,元件命名为sn74f27d,参考样题三图2(三输入的或非门)。

绘制带有子件的多元芯片,可采用“间接法”绘制, 参考“protel dxp 2004简明教程考证指南”p182页(参考资料) 。

3. 在库文件中建立不带有子件的新元件。

样图如图3所示,元件命名为p2c16c61-041p

方法:先采用“间接法”寻找,步骤同2,若不能找到相同或类似的,则采用“直接法”从头画起(参考教材第四章p120~p125)。

注意:1) 在画原理图时,将“捕获”功能去掉,即将“工具\文档选项\网格\捕获”前面的“√”去掉。

2) 若有背景栅格,一定要按照图上的尺寸画出准确的图形。

3) 元件管脚在工具箱最后一个图表中提取(管脚颜色为黑色)

4) 放置元件管脚的正确方法是:有灰色四个白点的一端必须在外边,带数字的一端与元件边框相连。

5) 数字电路集成块中必须画出电源和地线两个管脚,可采用左边元件库管理器中的“追加”来完成,且只在一个部分(如parta)画出来即可,画好后再将这两个管脚隐藏。(原图上有的就不必删除)

6) 一定要按照试卷的要求修改元件的元件名。(双击元件,调出元件属性窗口,然后修改:在default designator选项中输入u?、r?、c?..

7) 若关闭了左右两侧的功能按键,可通过操作右下角“system”调出。

8) 保存文件后再结束操作。

9) 点击图标“”,使其变为图标“”,以便自动缩放,使画图视窗调到最佳大小,提高其利用率。

第三题 pcb库操作(即:画元件封装图)

在设计项目文件中建立电路板图库文件文件\创建\库\pcb库(图标))

方法:1、 向导法(常用)

例如样题一中第三题的第1小题,在考生的设计项目文件中新建文件,按照样图4(a)要求创建元件封装,生成结果为图(b),命名为lcc48。

该题可参考教材第九章p259—p266。

2、 直接法(尽量少用)

如样题6的图5。参考教材p235—237页。

计算公式:内孔直径=管脚直径+0.2mm(8mil)

焊盘直径=内孔直径+1.2mm(48mil)

3、 间接法。

例如样题六中的第三题的第2小题,可先用向导法,选用dip模板,绘制4管脚的芯片封装图,然后再修改外边框的形状。

再如样题一中第三题的第2小题,在第1小题创建的库文件中新建整流桥的元件封装,名称为bridge。根据已知整流桥的管脚直径为45mil,选定合适内孔及焊盘直径大小,按照样图5要求创建元件封装。

该题可采用两种方法:

a、 利用上述计算公式算出内孔直径和焊盘外径,采用向导法直接绘制。

b、 将“工具\库选择项\可视栅格\网格2”中的数值改为该焊盘间距200mil, 然后采用“直接法”绘制。

4、 机械参数法。

如样题。二、三、四、六、八,参考 “protel dxp 2004简明教程考证指南” p157—p160、p182——184页(参考资料) 。

若用直接画法应注意:

1、 确定参考原点:执行“编辑\设定参考点\位置”,移动光标到相应的位置,点击鼠标左键,确定原点。

2、 改变网格2的数值为焊盘间距。

3、 注意换层,需在top over layer层画外形轮廓(颜色为黄色),与试题中图形不一致的,用手工修改。

4、 一定要修改元件的封装名称(按试题要求)。

5、 一定要保存文件后,再结束操作。

第四题、pcb板操作。

包括两部分:第一部分:将所给的原理图改画成层次原理图;

第一部分:在中制作电路板。

第一部分画层次电路图。

方法: ⅰ分图→总图(建议采用此种方法)

总图→分图。

重要步骤:1、文件的生成(以分图→总图为例)

调用第一题所做的模板“生成总图和分图。步骤如下:

1)在设计项目文件下建立总图和所有子图原理**件(文件\创建\原理图(图标)),先建立文件,再将改为相应的文件名,如总**件名为“流水灯电路。 schdoc”,子**件名为模块名称(如“主功能模块。 schdoc”)。

2)在所建立的父图和子图原理图界面内,点击“设计\模板\设计模板文件名…”,选中该项目的模板文件“然后点击“打开”,弹出另外一个“更新模板”窗口,选择“选择文档范围\当前项目中的所有原理图”,选择“选择参考动作\更换全部匹配参数”,再按“确定”,生成由模板转化成的总图和所有子图模块化文件。

注:也可分别由模板转化成的所需要的总图和子图模块化文件。

3)分别在总图和分图的界面中,点击“设计\文档选项\参数”,在“文件名”(=documentname)栏中分别输总图或各子图模块的名称。在“第……幅(=sheetnumber)”中输入该电路图图纸号码。

2、加库:通常加下面4个元件库和1个封装库。

1)杂件库miscellaneous devices. schlib

2)连接库miscellaneous connectors. schlib

3)ti库文件夹中相关元件库。

4)数字、模拟、数字集成电路元件库。

5)pcb footprints(电路板图封装库). pcblib

3、取元件:

注意:1)库中找不到的元件,可用“查找”搜寻。

2)为了有利于系列器件的排列,可同时输入元件的属性,如:r?→r1,c?→c1等,同类元件取一次,浮动情况下编辑属性,然后将本张图中的这类元件全部取出放置。

3)尽量用软件自带库中的元件,若从附加库中取出元件,应注意注意追加封装。

4、排列元件:

注意:1)依次将所有的元件取出,合理放在图纸上。

2)用大鼠标对齐元件,将原理图尽量放在图纸中间,图形大小适中。

3)当两个元件相距较近时,两元件的管脚之间最好有导线连接。

4)有网络标记的地方,要预留放网络标记的位置。

5、用配线工具箱的第一个“ ”图标画导线。

注意:1)要找对工具箱,不要选错图标。

2)若主工具箱或其他工具箱被关闭,可执行“查看\工具栏”,将其调出。

6、用配线工具箱中的“”图标放置网络标记。

7、总图的绘制,可参考教材p135-p138的内容介绍。

8、erc检测(总图): 点击“项目管理\compile pcb project cdy. prjpcb”。参考教材p97-p102内容介绍。

注意:1)电源、地线一定要连接正确,电源和接地的符号不能不标或标识错误。

2)对于一些不用进行erc检测的测试点,可添加“”,no erc(place\directives),如各子图中的端口处。

注意:观察生成的网络**,看是否有个别元件没有追加封装,若没有,回到原理图追加封装,并重新生成网络表。

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