2019数字系统设计期末试卷 10级 A卷

发布 2020-05-16 19:01:28 阅读 7469

c. 无cp输入端,有数据输入端; d. cp输入端与数据输入端相连。

2. 下面给出的表达式中不是恒等式。

a. a+ab=a+bb. ab+ab=ab+ab

c. ab+ab=(a+b)(a+bd. ab+ab+ab+ab=1

3. 以下各种电路的状态转换过程中不存在竞争-冒险现象。

a. 编码器b. 扭环形计数器。

c. 环形计数器d. 4位超前进位加法器。

4. 下面列出的选项中不能消除竞争-冒险。

a. 修改逻辑设计 b. 接入滤波电容 c. 引入选通脉冲 d. 进行时序**。

5. 在vhdl程序中,下面的类型中( )能够正确表达三态门的输出。

a. std_logic b. bit c. integer d. bit_vector

6. 逻辑函数f = a (ba

a. bb. ac. abd. (ab)

8. 图1电路由2个传输门tg1、tg2和3个或非门g1、g2、g3组成,其功能是。

a. 主从结构d触发器b. 边沿触发d触发器。

c. 同步d触发器d. 反相器。

9. 图2中,74290是异步二-五-十进制计数器,下降沿触发;clk0是二进制计数器脉冲输入,q0是输出;clk1是五进制计数器脉冲输入,q3q2q1是输出; r01、r01为异步清零端,高电平有效。则图2的电路的功能是。

a. 8进制计数器 b. 6进制计数器 c. 7进制计数器 d. 9进制计数器。

10. 为实现将jk触发器转换为d触发器,应使。

b. k=d,j= d

三、 判断改错题(判断下列命题正误,若错误,请改正过来,每小题2分,共20分)

1. 在使用七段字形译码器7448的过程中,灭灯输入端bi′与灭零输出端rbo′配合使用,可实现多位数码显示时的灭零功能。

2. 偶校验电路可以检测出偶数个码元发生错误的情况。

3. 将3个变量的异或运算写成与或表达式的形式,为:

abc=abc+abc+ abc+abc

4. 时序逻辑电路的输出方程与存储电路的次态有关。

5. 使用逻辑门时,一般不允许多余输入端悬空,对于或、或非、与或非中的或输入端,多余的输入端可以接在电源上,或与有用输入端并接。

6. 在vhdl程序中,为了能够读取某输出信号的状态,应将它设置为out模式。(

7. 设某个rs触发器的r、s输入端均为低有效,则它的约束条件为r+s=1

8. 一个逻辑函数的最简与或式及最小项表达式都不一定是唯一的。

9. 在vhdl语法中,变量赋值是立即生效的,不允许出现附加延时。

10. 状态转换图中,如果两个状态在相同的输入条件下,具有相同的次态,则这两个状态叫做等价状态。 (

四、 逻辑函数分析及化简,写出步骤(10分)

1. 某逻辑电路的输入d4d3d2d1是8421bcd码,电路输出y4y3y2y1为2421码(2421码的名字**于每一位的权重,2421码中1011相当于十进制数2+0+2+1=5,1100相当于十进制数2+4+0+0=6)。

1) 写出将8421码d4d3d2d1转换为2421码y4y3y2y1的真值表;(4分)

2) 用卡诺图方法化简,写出电路输出和输入之间的逻辑函数表达式。(6分)

五、 分析题:按要求完成下列各题,并写出分析步骤(13+14=27分)

1. (13分)分析下面电路实现的逻辑功能,并判断能否自启动,写出分析步骤。

1)写出电路的驱动方程和状态方程。(6分)

2)画出状态转换真值表,并判断电路能否自启动。(5分)

3)分析电路实现的逻辑功能。(2分)

2. (14分)分析如下分频电路的功能,其输入时钟频率为256khz,写出分析步骤,其中:

74hc161:十六进制计数器。

load为同步预置数控制端,低有效;

mr为异步复位控制端,低有效;

使能端enp=ent=1时,允许计数;

74hc253:双四选一数据选择器,由两个完全相同的4选1数据选择器构成。

1d0-1dd0-2d3是两组独立的数据输入端;

a1、a0是公共地址输入端;

1f、2f分别是两组4选1数据选择器的输出端;

1)分析该电路中74hc161的作用,74hc253的作用,以及电路的分频工作原理。 (4分)

2)当分频控制信号y1y0=10时,输出信号f1和f2的频率为多少?(4分)

3)欲使信号f1的频率为64khz,分频控制信号y1y0应该取什么值?(2分)

4)当分频控制信号y1y0取何值时,输出f1的频率最高?f1的最高频率为多少?(2分)

5)当分频控制信号y1y0取何值时,输出f2的频率最低?f2的最低频率为多少?(2分)

六、 设计题:根据要求设计电路,写出设计步骤(8+10=18分)

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