数字逻辑 2013期末复习一。
一、单项选择题。
1、n个变量可构成（ 3 ）个最小项。
n （2）2n-1 （3） （4）
2、集电极开路（oc）门电路如下所示，该电路实现的逻辑功能是（ 1 ）。
3、若两个逻辑函数表达式的对偶式f`和g`相等，则逻辑函数f和g（ 1 ）。
1）相等 （2）不相等 （3）可能等也可能不等 （4）互补。
4、为了实现将d触发器转换为jk触发器，d应等于（ 1 ）。
5、构成一个6进制加法计数器，至少需要（ 2 ）个触发器。
（1）2个 （2）3个 （3）4个 （4）5个。
6、对同一逻辑门电路，分别使用正逻辑和负逻辑表示输入和输出之间的关系，其表达式( 2 )。
(1) 互为反函数 (2) 互为对偶式 (3)相等4) 答案都不对。
7、f（a,b,c,d)=ab+cd,它包含的最小项个数是( 3 )
(1) 2个 (2) 4个 (3) 7个 (4) 8个。
8、下列编码是有效余三码的是( 3 )。
9、f(a,b,c,d)=ab+cd，变量a,b,c哪个取值组合能使f=1。( 2 )
10、八进制数（175.236）8的十六制数是( 1 )。
11、下列逻辑函数中，与（a+b）(a+c)等价的是( 3 )。
(1) f=ab (2)f=a+b(3) a+bc (4) f= b+c
12、函数f的卡诺图如图1-1，其最简与或表达式是( 4 )。
:10线译码器，输入信号端有( 4 )个。
14、用四选一数据选择器实现函数y=，应使( 1 )。
(1)d0=d2=0，d1=d3=1 (2)d0=d2=1，d1=d3=0
(3)d0=d1=0，d2=d3=1(4)d0=d1=1，d2=d3=0
15、时序电路中不可缺少的部分为( 2 )。
(1)组合电路 (2) 记忆电路 (3) 同步时钟信号 (4) 组合电路和记忆电路
16、与非门构成的基本rs触发器，欲使该触发器保持现态，即，则输入信号应为( 2 )。
1)s=r=0 (2)s=r=1 (3)s=1，r=0 (4)s=0，r=1
17、n个触发器构成的计数器中，有效状态最多有( 4 )个。
(1)n(2)2n (3)2n-1 (4)2n
18．把一个五进制计数器与一个**制计数器串联可得到( 4 )进制计数器。
19、双向数据总线常采用( 3 )构成。
(1) 数据分配器(2) 数据选择器(3)三态门(4)译码器。
20、最小项的逻辑相邻项是( 2 )。
(1)abcd (2)(3)(4)
21、 逻辑函数f（abc）=a⊙c的最小项标准式为( 3 )。
1)f=∑（0，32)
3)f=m0+m2+m5+m7 (4) f=∑（0，1，6，7）
22、 一个四输入端与非门，使其输出为0的输入变量取值组合有( 4 )种。
23、 设计一个四位二进制码的奇偶位发生器（假定采用偶检验码），需要( 3 )个异或门。
24、某符号二进制数原码为11010,其补码为( 4 )。
25、逻辑函数f1=∑m（2，3，4，5, 7，8, 9，10）,它们之间的关系是( 4 )。
(1)(2)(3)(4)、互为对偶式。
二、填空题（共x分，共 x题，每题1 分）
1、无符号二进制数（101101.101111）2的等值十六进制数是（
2、逻辑函数的反函数。
3、a和b都是逻辑变量则a+a+a +b+b+ba+b
4、已知函数的对偶式则它的原函数f=（
5、用n级触发器构成的计数器，计数容量最多可为（ 2n
6、的对偶式是。
7、逻辑代数的基本运算有(与) 、或) 、非) 三种。
8、（1001 1000）8421bcd=( 62 )16
9、有一个27种状态的编码，至少要用（ 5 ）个触发器来表示。
10、jk触发器的特性方程为qn+1=()d触发器的特性方程为qn+1=(d)，t触发器的特性方程为qn+1=()
11、布尔代数的基本规则有代入规则，（ 反演规则 ）和对偶规则。
12、用卡诺图法化简逻辑函数比布尔代数法更容易得到最简的逻辑函数表达式，缺点是（ 变量个数 ）受一定的限制。
13、数据分配器是一种单路输入，__多___输出的逻辑构件。
14、组合逻辑电路在结构上不存在输出到输入的___反馈___且电路的输出与_历史__输入状态无关。
15、采用一对一法进行状态编码时，10个状态需要用___4___个触发器实现。
16、利用并项法，的简化表达式为__ac
19、锁存器或触发器再电路上具有两个稳定的物理状态，我们把输入信号变化之前的状态称为__现态___输入信号变化后的状态称为___次态___
20、用计数器产生110010序列，至少需要___6___个触发器。
三、判断分析题（正确划上“√”错误划上“×”
bcd码具有奇偶特性。
× 2、与无符号二进制数（11001011）2等值的8421bcd码是（11001011）。
√ 3、ttl与非门电路不用的输入端可以悬空，悬空时，相当于“1”电平。
√ 4、若触发器的时钟端画了“小圆圈” ，则该触发器状态的转换发生在时钟脉冲的下降沿。
× 5、d触发器特性方程，这表明在任何情况下，q端总是和d端的状态一样。
× 6、逻辑代数中常量1大于常量0 。
√ 7、f(a,b,c)=∑m（0,1,2,3,4,5,6,7）=1 。
√ 8、在同一逻辑问题中，最大项mi的非等于最小项mi 。
× 9、推拉输出电路和oc电路间可以“线与”连接使用。
√ 10、格雷码的特点是任意二个相邻码组间只有一位变化。
四、逻辑函数化简。
1、用公式法化简下列函数为最简与或式。
2、用卡若图化简下列函数为最简与或式。
1） f(a,b,c,d)=∑m(3,6,8,9,11,12) +d(0,1,2,13,14,15)
五、组合逻辑电路题。
1、 根据下列电路列出函数式，并说明电路的逻辑功能。
根据函数真值表可知，该电路是一个三数不一致判断电路。
2、逻辑电路的输入信号abc与输出信号f的波形如下图所示。①列出逻辑函数f的真值表；②写出函数的逻辑表达式；③画出相应的电路图。
3、试用4选1数据选择器设计一个三变量的多数表决电路，设同意用“1”表示，不同意用“0”表示，表决通过用“1”表示，没有通过用“0”表示。作出真值表，画出电路图。
六、触发器。
1、由门和触发器构成的电路如下图所示，设触发器的起始状态为“0”，试根据时钟脉冲cp和a、b的输入画出q端的波形。
七、同步时序电路。
1、试分析下列同步时序逻辑电路，作出方程组、状态转换表、状态转换图、时序图并说出该电路完成什么功能。
j1=k1=1,q1n+1=q1n
j2=k2=q1,q2n+1=q1n⊕q2n
z=q1q2
该电路是一个模4加法计数器。
2、试用jk触发器设计一个“1001”串行序列检测器（可重叠），其输入为x，输出为z。作出状态转换图、状态转换表、求出激励方程和输出方程、画出电路图。
用隐含表法化简，,,是最大等效类，用b状态代替，可得如下最简状态表。
状态编码：a=00,b=11,c=10,d=01。
八、判断函数是否可能发生竞争？竞争的结果是否会产生险象？在什么情况下产生险象？若可能产生险象，用增加冗余项的方法消除。
从原始卡若图上可以看出电路会产生竞争，并会产生险象，当a=1,c=1,d=1,f=b+b,产生“0”型险象；
数字逻辑2019期末复习
数字逻辑 2013期末复习一。一 单项选择题。1 n个变量可构成 3 个最小项。n 2 2n 1 3 4 2 集电极开路 oc 门电路如下所示，该电路实现的逻辑功能是 1 3 若两个逻辑函数表达式的对偶式f 和g 相等，则逻辑函数f和g 1 1 相等 2 不相等 3 可能等也可能不等 4 互补。4 ...
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2019期末复习
小学六年级2011 2012学年度第二学期语文期末复习试卷 一 考试时间 100分钟 一 日积月累。35分 1 读拼音，写词语。5分 y u y f i cu m gu pi zu m i gu 2 给下面带点字注音全部正确的一组打 3分 1 惊羡 xi n 薄弱 lu鼻祖 z 2 压抑 y憧憬 j...