安徽大学20 10 —20 11 学年第二学期。
脉冲与数字电路》考试试卷（ b 卷）
闭卷时间120分钟）
考场登记表序号。
一、选择题（每题2分，共14分）
1. 十进制数118对应的16进制数为（ ）
a.（76）16b. （78）16
c.（e6）16d. （74）10
2. 逻辑函数=（
a. 0 b. a c. 1d.
3. 用编码器对17个信号进行编码，输出的二进制**的位数是。
a.2位 b.5位 c. 4位d. 6位。
4. 同相等的逻辑函数表达式是。
a. b. c. d.
5. 使用ttl集成门电路时，为实现线与逻辑功能，应该选用（ ）门电路。
a. 三态输出门b. ttl与门。
或非门d. oc门。
6. 下列各项中，是时序逻辑电路为。
a.译码器 b.移位寄存器 c. 加法器 d. 数值比较器。
7. 施密特触发器在波形整形应用中能有效消除叠加在脉冲信号上的噪声，是因为它具有特性。
a. 延时和定时 b. 计数与寄存 c. 整形与变换 d. 滞后特性。
二、填空题（每题2分，共10分）
1.，的最小项表达式为。
2. 逻辑函数的反函数。
3. 对于逻辑函数，为了化简，利用逻辑代数的基本定理，可表示为，但这可能引起现象，因为在时，化简前逻辑函数的值恒为1，但化简后逻辑函数的值为。
4. 一个5位二进制加法计数器，由00000开始，经过201个输入脉冲后，此计数器的状态为。
5. 要构成32k×16位的ram，需要8片8k×8的ram芯片，并需有根地址线。
三、化简题（每题8分，共16分）
1． 试简化函数（用代数法）
2． 试用卡诺图将下列逻辑函数化成最简与或式。
四、分析题（每题10分，共30分）
1. 写出下图所示电路中灯l与开关a、b、c的与或逻辑表达式。（设开关合上状态为1，断开状态为0；灯亮状态为1，灯灭状态为0）.
2.下图所示电路为两片中规模集成十六进制同步计数器74ls161实现的计数器，电路由一个宽脉冲启动开始工作。74161的功能表如下。
要求：（1）列出该电路的状态转移图？（2）分析说明该电路的计数输出模值？
3. 分析如图所示电路，写出f的最小项表达式。
五、设计题（每题10分，共30分）
1.在输入信号a,b,c,d的作用下，f(a,b,c,d)=∑m(4,5,6,9,10, 12, 13 ,14)。
用如下器件分别实现函数f，给出设计步骤，画出各自实现的具体逻辑电路图：
1）仅用与非门；
2）一片“8选1数据选择器（74ls151）”，加少量门电路。
2. 试用十六进制同步计数器74ls161设计一个6进制的计数器，并在电路图中给出6进制计数进位输出信号。要求利用复位端作为控制信号，说明设计思路，可以附加必要的门电路。
3．用上升沿d触发器设计一个彩灯控制逻辑电路。红、黄、绿三色彩灯(r,y,g)，要求在时钟信号cp的控制下，三个灯的状态按照图中顺序循环变化。图中涂黑的圆圈表示灯熄灭，空白的圆圈表示灯亮。
图中没有出现的组合状态要求都能直接自动转到全熄灭的状态。
要求（1）给出设计过程；（2）画出设计电路框图(可以配合使用小规模门电路)。
安徽大学20 10 —20 11 学年第二学期。
脉冲与数字电路》考试试卷（a卷）
闭卷时间120分钟）
考场登记表序号。
一、选择题（每题2分，共14分）
1. jk触发器的状态转移方程为（ ）
a. b.
c. d.
2. 三变量函数f(a,b,c)=a+bc的最小项表示中不含下列哪项。
a. m2b. m5c. m3d. m7
3. 为了避免干扰，mos与门的多余输入端不能（ ）处理。
a． 悬空 b． 接低电平 c．与有用输入端并接 d． 以上都不正确。
4. 将十进制数(18)10 转换成八进制数是（ ）
a. 20b. 21c. 22d. 23
5. 下面式子中，单变量变化不会产生逻辑冒险的是。
ab. cd.
6. 用与非门构成基本触发器发生竞争现象时，输入端的变化是。
a．00→11b. 01→10 c. 11→00d. 10→01
7. 一个5位二进制加法计数器，由00000开始，经过201个输入脉冲后，此计数器的状态为。
a．01000 b. 01111 c. 00111 d. 01001
二、填空题（每题2分，共14分）
1. 利用二极管的开关特性可以做成波形的限幅电路和电路。
2. 一般来说，使用数据选择器可以实现单输出函数，使用和附加逻辑门可实现。
多输出函数。
3. 任意两个最小项之积为。
4. 用全加器将余3bcd码转换成8421bcd码时，一端接余3bcd码，另一端应。
接。5. 对n个变量，最小项的个数为。
6. 施密特触发器能有效消除叠加在脉冲信号上的噪声，因为它具有特性。
7. 如果要用j-k触发器来实现d触发器功能，则d,j,k三者关系为。
三、简答题（每题6分，共12分）
1. 在完全描述状态表中，两个状态等价，则这两个状态可以合并为一个状态，那么两个状态等价的条件是什么？
2. 简述异步时序逻辑电路设计中，选择各级触发器时钟信号的原则。
四、分析题（每题10分，共30分）
1. 有三个输入信号，如果三个输入信号均为0或其中一个为1时，输出信号y=1，其余情况下输出y=0。列出真值表，写出标准与或表达式，并用卡诺图化简。
2. 画出如图1所示电路输出q的工作波形，其中输入波形如图2所示，设q的初始状态为0。
图1图23. 写出图3所示电路的名称，并根据图4的输入波形画出工作波形。
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