湘潭大学09级2023年数字电子技术考试试卷

发布 2021-12-28 06:14:28 阅读 2769

一、填空题:(每空1分,共14分)

1、数制转换:,。

2、若a/d转换器(包括取样—保持电路)输入模拟电压信号的最高变化频率为10khz,则取样频率的下限为(20khz)。

3、正数的补码和它的( 原码 )相同,负数的补码可通过将( 原码取反得到反码,再加一 )得到。

4、试列出3种输出端可以并联使用的门电路:(三态门od门)、(oc门)。

5、( 门电路 )和( 触发器 )是构成各种复杂数字系统的基本逻辑单元。

6、**换精度)和**换速率)是衡量a/d转换器和d/a转换器性能优劣的主要标志。

二、化简题:(每小题6分,共12分)

1)、用逻辑函数公式某法证明:

b’cd’+bc’d+acd+a’bc’d’+a’b’cd+bc’d’+bcd=b’c+bc’+cd。

证:左边=2)、试用卡诺图法化简下式,要求画出卡诺图,并勾圈化简:

三、由与非门构成的某表决电路如图1所示,其中abcd表示4个人,l=1时表示决议通过。(共10分)

1)试分析电路,说明决议通过的情况有几种。

2)分析abcd四个人中,谁的权利最大。

图1四、某逻辑函数的真值表如表1.2所示,试将74hc153扩展为8选1数据选择器,再实现该逻辑函数。74hc153的功能与逻辑符号分别见表1.1和图2。(共15分)

五、已知74ls138的逻辑符号见图3,逻辑功能见表2.试画出用两片74ls138组成4线-16线译码器的接线图,并说明设计原理。(共10分)

图3表ls138功能表。

六、分析图4给出的电路,说明这是多少进制的计数器。要求有分析过程。提示:74160是十进制加减计数器,并步清零,同步置数。(共10分)

图4七、图5是一个ne555定时器的应用电路。

1)、指出电路名称; (2)、计算相关参数。(共7分)

图5八、ram2114(1k×4)组成图6所示电路。图中74ls138的功能表见题五表2。(共10分)

1)、确定图示电路内存单元的容量是多少?若要实现2k×8的内存,需要多少片2114芯片?

2)、写出2114-1至2114-3的地址范围(用十六进制表示)。

图6九、试用jk-fe设计一个同步余3循环码十进制减法计数器,其状态转换图如图7所示。(共12分)图7

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