航天772所高校专项科研计划2023年度招标项目指南（简版）
目录。一、项目指南 1
1.1 基于sopc芯片的微纳卫星综合电子系统设计与测试技术 1
1.2 基于8位微控制器的全数字dc/dc模块的设计 2
1.3 esd设计技术研究 3
1.4 1gbps~2.5gbps 高速serdes电路研究 4
1.5 spacewire总线应用开发环境设计 5
1.6 星载异构多核可重构soc集成开发环境设计 6
1.7 sparc v8处理器**模型接口设计及验证 7
1.8 倒装焊陶瓷封装可靠性评估及检测 8
1.9 低照度微光探测器 9
1.10 高帧频cmos相机图像采集处理技术 10
1.11 fpga测试向量开发自动化技术 11
1.12 伪距定位算法研发 12
1.13 高精度载波相位定位算法研究 13
1.14 基于硅基技术的射频功率放大器（rfpa）设计 14
二、特别声明 15
三、**** 15
一、项目指南。
1.1 基于sopc芯片的微纳卫星综合电子系统设计与测试技术。
1.1.1研究内容。
该项目面向微纳卫星综合电子应用，兼容 cubesat、nanosat标准卫星接口低轨应用，基于国产sopc芯片研发兼容cubesat架构的微纳卫星综合电子系统及其配套软件。研究内容包括：
1) 基于sopc芯片计算机板设计、调试；
2) 操作系统及其bsp移植；
3) 多传感器融合控制算法研制和移植；
4) 搭建演示系统及其系统测试。
注：此项目甲方可提供相关硬件模块和软件环境。
1.1.2成果形式。
1) 计算机板。
2) 控制软件c语言源码和matlab**环境。
3) 实验演示系统。
4) 设计文档、使用手册、实验报告、**。
1.1.3技术指标。
1) sparc v8处理器内核。
2) 控制软件姿态定位精度（二维定位精度<10m; 高程精度<12m; 三轴指向精度：<10）
3) 尺寸、重量符合详版要求。
1.1.4研制周期和课题经费。
研制周期：2年。
课题经费：35万元。
1.2 基于8位微控制器的全数字dc/dc模块的设计。
依托于我所8位微控制器、adc转换器、模拟开关和功率驱动器件，研究全数字dc/dc的基础部分拓扑结构和核心部分控制器，形成一套完整的全数字dc/dc解决方案。研究内容包括：
1) 全数字dc/dc的拓扑结构；
2) 核心控制器的体系结构和算法；
3) 全数字dc/dc模块的演示实验板。
1) 输入电压：28v
2) 输出电压：单路输出，+5v
3) 输出功率：5w
4) 输出输入隔离：是。
5) 输出纹波：50mvp-p
6) 效率：90%
7) 过压保护：额定输出电压以上±10%
8) 上电过冲：<5%额定电压，单调上升。
9) 输出电压：可调节。
研制周期：2年。
课题经费：20万。
1.3 esd设计技术研究。
1） cmos集成电路高压输入esd防护技术。
基于指定工艺，可保证80 pin 芯片2000v esd（hbm）通过的保护结构。
2） 多电压域混合信号soc全芯片esd设计技术。
基于指定工艺，针对三个（含）以上domain域的esd设计技术研究，解决嵌入式模拟ip隔离引起的多个（三个以上）电压域之间的全芯片esd减弱问题。
3） 器件级、电路级esd**技术研究。
基于指定工艺，针对不同结构的有效器件与电路，开发esd**环境，建立esd**模型，掌握esd**方法，达到可预先评估esd设计水平的目的。
研制周期：2年。
课题经费：20万。
1.4 1gbps~2.5gbps 高速serdes电路研究。
1.4.1研究内容。
本课题的研究对象为8b/10b serdes，工作频率1gbps~2.5gbps，工作电压2.5v，具有片上8-bit/10-bit编/解码器及comma检测功能，用片上pll实现对低速参考时钟的频率综合。
通过本课题的研究，需实现以下关键技术的突破：
1) 高速时钟和数据恢复(cdr)技术。
2) 串行输出的可编程预加重(programmable preemphasis) 技术。
3) 信号丢失检测(los)技术。
4) comma检测(comma detect)技术。
研制周期：2年。
课题经费：30万。
1.5 spacewire总线应用开发环境设计。
1.5.1研究内容。
基于航天772所研制的spacewire通讯芯片组，立足国内应用需求，建立spacewire网络应用开发平台，研究链路冗余方案和网络传输的时间确定性方案，开发spacewire网络驱动程序，实现网络应用和数据传输效率、误码、传输延迟等性能评估，支持spacewire网络冗余。
1) 完善的spacewire网络硬件环境，包括基于5个通讯控制器的节点和2个路由器节点。
2) 完善的spacewire网络应用程序和支持库，可对网络进行性能评估。
3) 完整的spacewire网络开发平台软、硬件文档。
1) spacewire总线传输速率200mbps，系统时钟大于30mhz。
2) 节点板和路由器板具有pci、usb和ethernet接口。
3) 网络系统具备误码率测试能力，具备网络性能评估、监控能力和冗余能力。
研制周期：2年。
课题经费：20万。
1.6 星载异构多核可重构soc集成开发环境设计。
1.6.1研究内容。
基于eclipse平台，研究针对异构多核可重构soc的软件开发工具集成和管理方法，研制具有良好图形界面的多核系统一体化集成开发环境，实现程序开发、调试、优化和数据可视化，有效支持多核soc的推广与应用。具体研究内容包括：
1） 并行编程技术研究。
2） 多核调试器设计技术研究。
3） 多核性能分析工具技术研究。
4） 函数库设计。
1) 完整的多核集成开发软件系统。
2) 规范的软件系统文档。
3) 典型应用示范。
1) 支持主流操作系统平台。
2) 并行程序开发工具。
3) 多核调试模块。
4) 性能分析工具。
5) 函数库。
研制周期：2年。
课题经费：30万。
1.7 sparc v8处理器**模型接口设计及验证。
1.7.1研究内容。
基于sparc v8指令精确模型，设计amba总线接口；建立验证环境、设计验证激励，进行sparc v8**模型及amba接口的功能验证；对v8**模型及验证环境和激励进行封装，实现参数配置和自动运行。完成基于sparc v8的soc设计、性能分析、功能验证、ip集成。
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