EDA大作业

eda技术课程大作业。

设计题目： 4线-16线译码器设计。

学生姓名。学号。

专业班级： 09电子信息1班

2023年5月26日。

4线-8线译码器设计。

1.设计背景与设计方案。

1.1设计背景。

译码器是组合逻辑电路的一个重要器件，它是一种将一种编码转换为另一种编码的逻辑电路，在编码时，每一种二进制**都赋予了特定含义，即都表示一个确定的信号或者对象，译码将输入的二进制信号翻译成输出信号，输出信号可是高电平或者低电平，也可以是脉冲。本设计用vhdl编写程序，封装了一个4线-16线译码器，实现000～111的译码。

1.2设计方案。

4线-16线译码器**电路图如1-1所示；

图1-1 4线-16线译码器**电路图。

该译码器电路包含22个引脚，有4个输入端din0、din1、din2、din3，16个输出端，从dout0到dout15，共计16个引脚；1个使能端引脚en,1个时钟信号clk。

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